Sensor IP-Cores

IP-Cores für Sony Pregius Sub-LVDS- und MIPI CSI-2-Bildsensoren

At a glance
  • Deserialisierung und Decodierung von Bildsensordaten
  • Softwarebibliothek zur Sensorkonfiguration
  • Mit AMD-FPGAs kompatibel
  • Lieferung als funktionierendes Referenzdesign für schnelle Entwicklungen
 
IMX Pregius IP Core

IP-Core für Sony Pregius Sub-LVDS-Bildsensoren

 
MIPI CSI-2 Receiver IP Core

IP-Core für MIPI CSI-2-Imager

Ein Produkt von Sensor to Image
Ein Produkt von Sensor to Image


Kürzere Markteinführungszeit

Anbieter von Machine-Vision-Kameras reduzieren die Markteinführungszeit mit Transportschicht-IP-Cores und verlassen sich auf Sensor to Image, um mit Fortschritten in Technologie und bei Standards Schritt zu halten.
Zum Streamen von Bildern von der Kamera zum Host gibt es mehrere moderne Vision-Standards für die Transportschicht. Die leistungsstärksten (GigE Vision, USB3, CoaXPress ...) mögen jedoch komplex erscheinen und sich in ständiger Weiterentwicklung befinden. Mit den IP-Cores von Sensor to Image können Machine-Vision-Unternehmen Monate an Entwicklungsarbeit verkürzen, um FPGA-basierte Produkte gemäß diesen Standards zu entwickeln, die höchstmögliche Leistung bei geringem Platzbedarf und minimaler Entwicklungszeit bieten.


Beschreibung vom IMX Pregius-IP-Core

IMX Pregius von Sony ist eine Serie weitverbreiteter hochwertiger CMOS-Bildsensoren. Der IMX Pregius IP Core von S2I unterstützt diese Sensoren und kann ihre Daten lesen sowie auch steuern. Er wird als vollständig funktionierendes Referenzdesign geliefert und auf einer vereinbarten gemeinsamen Bereitstellungsplattform zusammen mit einem FMC-Modul ausgeführt, welches mit dm MVDK von S2I und FPGA-Standardevaluierungskits kompatibel ist. Zusammen bieten sie eine einfache Möglichkeit, eine Kamera zu designen.


Beschreibung vom MIPI CSI-2-IP-Core

Bildsensoren mit MIPI-Schnittstelle werden nicht nur in Mobiltelefonen verwendet, sondern auch in Industrie- und Automobilanwendungen. Viele dieser Anwendungen erfordern ein FPGA für die Steuerung und weitere Verarbeitung. Dieser IP-Core unterstützt die Vernetzung von MIPI-Sensoren anderer Anbieter mit FPGAs. Der IP-Core basiert auf einer vorhandenen D-PHY-Implementierung, die in der Regel bei FPGA-Anbietern erhältlich ist. Der IP-Core wird als vollständig funktionierendes Referenzdesign geliefert. Dieses wird auf einer vereinbarten gemeinsamen Bereitstellungsplattform zusammen mit einem MIPI-FMC-Modul ausgeführt, welches mit dem MVDK von S2I und FPGA-Standardevaluierungskits kompatibel ist. Zusammen bieten sie eine einfache Möglichkeit, eine Kamera zu designen.


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